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[PeepholeOptimizer] Enhance the redundant COPY elimination.
- Eliminate redundant COPYs from the same register & subregister pair. Differential Revision: https://reviews.llvm.org/D87939
This commit is contained in:
Michael Liao
parent
f0dc47fc06
commit
43a4d1cdda
@ -215,11 +215,11 @@ namespace {
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||||
RecurrenceCycle &RC);
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||||
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||||
/// If copy instruction \p MI is a virtual register copy, track it in
|
||||
/// the set \p CopySrcRegs and \p CopyMIs. If this virtual register was
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||||
/// previously seen as a copy, replace the uses of this copy with the
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||||
/// previously seen copy's destination register.
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||||
bool foldRedundantCopy(MachineInstr &MI, SmallSet<Register, 4> &CopySrcRegs,
|
||||
DenseMap<Register, MachineInstr *> &CopyMIs);
|
||||
/// the set \p CopyMIs. If this virtual register was previously seen as a
|
||||
/// copy, replace the uses of this copy with the previously seen copy's
|
||||
/// destination register.
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||||
bool foldRedundantCopy(MachineInstr &MI,
|
||||
DenseMap<RegSubRegPair, MachineInstr *> &CopyMIs);
|
||||
|
||||
/// Is the register \p Reg a non-allocatable physical register?
|
||||
bool isNAPhysCopy(Register Reg);
|
||||
@ -1392,11 +1392,11 @@ bool PeepholeOptimizer::foldImmediate(
|
||||
//
|
||||
// Should replace %2 uses with %1:sub1
|
||||
bool PeepholeOptimizer::foldRedundantCopy(
|
||||
MachineInstr &MI, SmallSet<Register, 4> &CopySrcRegs,
|
||||
DenseMap<Register, MachineInstr *> &CopyMIs) {
|
||||
MachineInstr &MI, DenseMap<RegSubRegPair, MachineInstr *> &CopyMIs) {
|
||||
assert(MI.isCopy() && "expected a COPY machine instruction");
|
||||
|
||||
Register SrcReg = MI.getOperand(1).getReg();
|
||||
unsigned SrcSubReg = MI.getOperand(1).getSubReg();
|
||||
if (!SrcReg.isVirtual())
|
||||
return false;
|
||||
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||||
@ -1404,20 +1404,17 @@ bool PeepholeOptimizer::foldRedundantCopy(
|
||||
if (!DstReg.isVirtual())
|
||||
return false;
|
||||
|
||||
if (CopySrcRegs.insert(SrcReg).second) {
|
||||
RegSubRegPair SrcPair(SrcReg, SrcSubReg);
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||||
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||||
if (CopyMIs.insert(std::make_pair(SrcPair, &MI)).second) {
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||||
// First copy of this reg seen.
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||||
CopyMIs.insert(std::make_pair(SrcReg, &MI));
|
||||
return false;
|
||||
}
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||||
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||||
MachineInstr *PrevCopy = CopyMIs.find(SrcReg)->second;
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||||
MachineInstr *PrevCopy = CopyMIs.find(SrcPair)->second;
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||||
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||||
unsigned SrcSubReg = MI.getOperand(1).getSubReg();
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||||
unsigned PrevSrcSubReg = PrevCopy->getOperand(1).getSubReg();
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||||
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||||
// Can't replace different subregister extracts.
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if (SrcSubReg != PrevSrcSubReg)
|
||||
return false;
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||||
assert(SrcSubReg == PrevSrcSubReg && "Unexpected mismatching subreg!");
|
||||
|
||||
Register PrevDstReg = PrevCopy->getOperand(0).getReg();
|
||||
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||||
@ -1631,9 +1628,9 @@ bool PeepholeOptimizer::runOnMachineFunction(MachineFunction &MF) {
|
||||
// without any intervening re-definition of $physreg.
|
||||
DenseMap<Register, MachineInstr *> NAPhysToVirtMIs;
|
||||
|
||||
// Set of virtual registers that are copied from.
|
||||
SmallSet<Register, 4> CopySrcRegs;
|
||||
DenseMap<Register, MachineInstr *> CopySrcMIs;
|
||||
// Set of pairs of virtual registers and their subregs that are copied
|
||||
// from.
|
||||
DenseMap<RegSubRegPair, MachineInstr *> CopySrcMIs;
|
||||
|
||||
bool IsLoopHeader = MLI->isLoopHeader(&MBB);
|
||||
|
||||
@ -1644,9 +1641,10 @@ bool PeepholeOptimizer::runOnMachineFunction(MachineFunction &MF) {
|
||||
++MII;
|
||||
LocalMIs.insert(MI);
|
||||
|
||||
// Skip debug instructions. They should not affect this peephole optimization.
|
||||
// Skip debug instructions. They should not affect this peephole
|
||||
// optimization.
|
||||
if (MI->isDebugInstr())
|
||||
continue;
|
||||
continue;
|
||||
|
||||
if (MI->isPosition())
|
||||
continue;
|
||||
@ -1721,9 +1719,8 @@ bool PeepholeOptimizer::runOnMachineFunction(MachineFunction &MF) {
|
||||
continue;
|
||||
}
|
||||
|
||||
if (MI->isCopy() &&
|
||||
(foldRedundantCopy(*MI, CopySrcRegs, CopySrcMIs) ||
|
||||
foldRedundantNAPhysCopy(*MI, NAPhysToVirtMIs))) {
|
||||
if (MI->isCopy() && (foldRedundantCopy(*MI, CopySrcMIs) ||
|
||||
foldRedundantNAPhysCopy(*MI, NAPhysToVirtMIs))) {
|
||||
LocalMIs.erase(MI);
|
||||
LLVM_DEBUG(dbgs() << "Deleting redundant copy: " << *MI << "\n");
|
||||
MI->eraseFromParent();
|
||||
|
||||
@ -298,82 +298,67 @@ define amdgpu_ps i128 @extractelement_sgpr_v4i128_vgpr_idx(<4 x i128> addrspace(
|
||||
; GFX9-LABEL: extractelement_sgpr_v4i128_vgpr_idx:
|
||||
; GFX9: ; %bb.0:
|
||||
; GFX9-NEXT: s_load_dwordx16 s[0:15], s[2:3], 0x0
|
||||
; GFX9-NEXT: v_lshlrev_b32_e32 v2, 1, v0
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 1, v2
|
||||
; GFX9-NEXT: v_lshlrev_b32_e32 v0, 1, v0
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 1, v0
|
||||
; GFX9-NEXT: v_add_u32_e32 v19, 1, v0
|
||||
; GFX9-NEXT: s_waitcnt lgkmcnt(0)
|
||||
; GFX9-NEXT: v_mov_b32_e32 v3, s0
|
||||
; GFX9-NEXT: v_mov_b32_e32 v1, s2
|
||||
; GFX9-NEXT: v_mov_b32_e32 v0, s1
|
||||
; GFX9-NEXT: v_mov_b32_e32 v1, s0
|
||||
; GFX9-NEXT: v_mov_b32_e32 v2, s1
|
||||
; GFX9-NEXT: v_mov_b32_e32 v3, s2
|
||||
; GFX9-NEXT: v_mov_b32_e32 v4, s3
|
||||
; GFX9-NEXT: v_mov_b32_e32 v5, s4
|
||||
; GFX9-NEXT: v_mov_b32_e32 v6, s5
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v1, v3, v1, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v0, v0, v4, vcc
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 2, v2
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v1, v1, v5, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v0, v0, v6, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v17, v1, v3, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v18, v2, v4, vcc
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 2, v0
|
||||
; GFX9-NEXT: v_mov_b32_e32 v7, s6
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 3, v2
|
||||
; GFX9-NEXT: v_mov_b32_e32 v8, s7
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v1, v1, v7, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v0, v0, v8, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v17, v17, v5, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v18, v18, v6, vcc
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 3, v0
|
||||
; GFX9-NEXT: v_mov_b32_e32 v9, s8
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 4, v2
|
||||
; GFX9-NEXT: v_mov_b32_e32 v10, s9
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v1, v1, v9, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v0, v0, v10, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v17, v17, v7, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v18, v18, v8, vcc
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 4, v0
|
||||
; GFX9-NEXT: v_mov_b32_e32 v11, s10
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 5, v2
|
||||
; GFX9-NEXT: v_mov_b32_e32 v12, s11
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v1, v1, v11, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v0, v0, v12, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v17, v17, v9, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v18, v18, v10, vcc
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 5, v0
|
||||
; GFX9-NEXT: v_mov_b32_e32 v13, s12
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 6, v2
|
||||
; GFX9-NEXT: v_mov_b32_e32 v14, s13
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v1, v1, v13, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v4, v0, v14, vcc
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 7, v2
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v17, v17, v11, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v18, v18, v12, vcc
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 6, v0
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v17, v17, v13, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v18, v18, v14, vcc
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 1, v19
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v1, v1, v3, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v2, v2, v4, vcc
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e64 s[0:1], 2, v19
|
||||
; GFX9-NEXT: v_mov_b32_e32 v15, s14
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 7, v0
|
||||
; GFX9-NEXT: v_mov_b32_e32 v16, s15
|
||||
; GFX9-NEXT: v_add_u32_e32 v2, 1, v2
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v0, v1, v15, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v1, v4, v16, vcc
|
||||
; GFX9-NEXT: v_mov_b32_e32 v4, s1
|
||||
; GFX9-NEXT: v_mov_b32_e32 v5, s2
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 1, v2
|
||||
; GFX9-NEXT: v_mov_b32_e32 v6, s3
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v3, v3, v5, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v4, v4, v6, vcc
|
||||
; GFX9-NEXT: v_mov_b32_e32 v7, s4
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 2, v2
|
||||
; GFX9-NEXT: v_mov_b32_e32 v8, s5
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v3, v3, v7, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v4, v4, v8, vcc
|
||||
; GFX9-NEXT: v_mov_b32_e32 v9, s6
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 3, v2
|
||||
; GFX9-NEXT: v_mov_b32_e32 v10, s7
|
||||
; GFX9-NEXT: v_cndmask_b32_e64 v1, v1, v5, s[0:1]
|
||||
; GFX9-NEXT: v_cndmask_b32_e64 v2, v2, v6, s[0:1]
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e64 s[0:1], 3, v19
|
||||
; GFX9-NEXT: v_cndmask_b32_e64 v3, v1, v7, s[0:1]
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v0, v17, v15, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v1, v18, v16, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e64 v2, v2, v8, s[0:1]
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 4, v19
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v3, v3, v9, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v4, v4, v10, vcc
|
||||
; GFX9-NEXT: v_mov_b32_e32 v11, s8
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 4, v2
|
||||
; GFX9-NEXT: v_mov_b32_e32 v12, s9
|
||||
; GFX9-NEXT: v_mov_b32_e32 v13, s10
|
||||
; GFX9-NEXT: v_mov_b32_e32 v5, s11
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v2, v2, v10, vcc
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 5, v19
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v3, v3, v11, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v4, v4, v12, vcc
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 5, v2
|
||||
; GFX9-NEXT: v_mov_b32_e32 v6, s12
|
||||
; GFX9-NEXT: v_mov_b32_e32 v7, s13
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v2, v2, v12, vcc
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 6, v19
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v3, v3, v13, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v4, v4, v5, vcc
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 6, v2
|
||||
; GFX9-NEXT: v_mov_b32_e32 v8, s14
|
||||
; GFX9-NEXT: v_mov_b32_e32 v9, s15
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v3, v3, v6, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v4, v4, v7, vcc
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 7, v2
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v2, v3, v8, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v3, v4, v9, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v4, v2, v14, vcc
|
||||
; GFX9-NEXT: v_cmp_eq_u32_e32 vcc, 7, v19
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v2, v3, v15, vcc
|
||||
; GFX9-NEXT: v_cndmask_b32_e32 v3, v4, v16, vcc
|
||||
; GFX9-NEXT: v_readfirstlane_b32 s0, v0
|
||||
; GFX9-NEXT: v_readfirstlane_b32 s1, v1
|
||||
; GFX9-NEXT: v_readfirstlane_b32 s2, v2
|
||||
@ -383,82 +368,67 @@ define amdgpu_ps i128 @extractelement_sgpr_v4i128_vgpr_idx(<4 x i128> addrspace(
|
||||
; GFX8-LABEL: extractelement_sgpr_v4i128_vgpr_idx:
|
||||
; GFX8: ; %bb.0:
|
||||
; GFX8-NEXT: s_load_dwordx16 s[0:15], s[2:3], 0x0
|
||||
; GFX8-NEXT: v_lshlrev_b32_e32 v2, 1, v0
|
||||
; GFX8-NEXT: v_cmp_eq_u32_e32 vcc, 1, v2
|
||||
; GFX8-NEXT: v_lshlrev_b32_e32 v0, 1, v0
|
||||
; GFX8-NEXT: v_cmp_eq_u32_e32 vcc, 1, v0
|
||||
; GFX8-NEXT: s_waitcnt lgkmcnt(0)
|
||||
; GFX8-NEXT: v_mov_b32_e32 v3, s0
|
||||
; GFX8-NEXT: v_mov_b32_e32 v1, s2
|
||||
; GFX8-NEXT: v_mov_b32_e32 v0, s1
|
||||
; GFX8-NEXT: v_mov_b32_e32 v1, s0
|
||||
; GFX8-NEXT: v_mov_b32_e32 v3, s2
|
||||
; GFX8-NEXT: v_mov_b32_e32 v2, s1
|
||||
; GFX8-NEXT: v_mov_b32_e32 v4, s3
|
||||
; GFX8-NEXT: v_mov_b32_e32 v5, s4
|
||||
; GFX8-NEXT: v_mov_b32_e32 v6, s5
|
||||
; GFX8-NEXT: v_cndmask_b32_e32 v1, v3, v1, vcc
|
||||
; GFX8-NEXT: v_cndmask_b32_e32 v0, v0, v4, vcc
|
||||
; GFX8-NEXT: v_cmp_eq_u32_e32 vcc, 2, v2
|
||||
; GFX8-NEXT: v_cndmask_b32_e32 v1, v1, v5, vcc
|
||||
; GFX8-NEXT: v_cndmask_b32_e32 v0, v0, v6, vcc
|
||||
; GFX8-NEXT: v_cndmask_b32_e32 v17, v1, v3, vcc
|
||||
; GFX8-NEXT: v_cndmask_b32_e32 v18, v2, v4, vcc
|
||||
; GFX8-NEXT: v_cmp_eq_u32_e32 vcc, 2, v0
|
||||
; GFX8-NEXT: v_mov_b32_e32 v7, s6
|
||||
; GFX8-NEXT: v_cmp_eq_u32_e32 vcc, 3, v2
|
||||
; GFX8-NEXT: v_mov_b32_e32 v8, s7
|
||||
; GFX8-NEXT: v_cndmask_b32_e32 v1, v1, v7, vcc
|
||||
; GFX8-NEXT: v_cndmask_b32_e32 v0, v0, v8, vcc
|
||||
; GFX8-NEXT: v_cndmask_b32_e32 v17, v17, v5, vcc
|
||||
; GFX8-NEXT: v_cndmask_b32_e32 v18, v18, v6, vcc
|
||||
; GFX8-NEXT: v_cmp_eq_u32_e32 vcc, 3, v0
|
||||
; GFX8-NEXT: v_mov_b32_e32 v9, s8
|
||||
; GFX8-NEXT: v_cmp_eq_u32_e32 vcc, 4, v2
|
||||
; GFX8-NEXT: v_mov_b32_e32 v10, s9
|
||||
; GFX8-NEXT: v_cndmask_b32_e32 v1, v1, v9, vcc
|
||||
; GFX8-NEXT: v_cndmask_b32_e32 v0, v0, v10, vcc
|
||||
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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; GISEL-NEXT: v_mul_hi_u32 v9, v5, v9
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|
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|
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; GISEL-NEXT: v_mul_hi_u32 v10, v4, v7
|
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; GISEL-NEXT: v_mul_hi_u32 v7, v5, v7
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
||||
; GISEL-NEXT: v_addc_u32_e32 v5, vcc, v5, v8, vcc
|
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; GISEL-NEXT: v_add_i32_e32 v4, vcc, v4, v7
|
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; GISEL-NEXT: v_addc_u32_e32 v5, vcc, 0, v5, vcc
|
||||
; GISEL-NEXT: v_mul_lo_u32 v7, v3, v4
|
||||
; GISEL-NEXT: v_mul_lo_u32 v8, v2, v5
|
||||
; GISEL-NEXT: v_mul_hi_u32 v10, v2, v4
|
||||
; GISEL-NEXT: v_mul_hi_u32 v4, v3, v4
|
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|
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|
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|
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|
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; GISEL-NEXT: v_cndmask_b32_e64 v7, 0, 1, vcc
|
||||
; GISEL-NEXT: v_mul_lo_u32 v10, v3, v5
|
||||
; GISEL-NEXT: v_add_i32_e32 v7, vcc, v8, v7
|
||||
; GISEL-NEXT: v_mul_hi_u32 v8, v2, v5
|
||||
; GISEL-NEXT: v_mul_hi_u32 v5, v3, v5
|
||||
; GISEL-NEXT: v_add_i32_e32 v4, vcc, v10, v4
|
||||
; GISEL-NEXT: v_cndmask_b32_e64 v10, 0, 1, vcc
|
||||
; GISEL-NEXT: v_add_i32_e32 v4, vcc, v4, v8
|
||||
; GISEL-NEXT: v_cndmask_b32_e64 v8, 0, 1, vcc
|
||||
; GISEL-NEXT: v_add_i32_e32 v8, vcc, v10, v8
|
||||
; GISEL-NEXT: v_add_i32_e32 v4, vcc, v4, v7
|
||||
; GISEL-NEXT: v_cndmask_b32_e64 v7, 0, 1, vcc
|
||||
; GISEL-NEXT: v_add_i32_e32 v7, vcc, v8, v7
|
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||||
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||||
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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; CHECK-NEXT: v_add_i32_e32 v2, vcc, v3, v2
|
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@ -319,21 +321,19 @@ define amdgpu_ps i64 @s_srem_i64(i64 inreg %num, i64 inreg %den) {
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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; CHECK-NEXT: v_cndmask_b32_e64 v5, 0, -1, vcc
|
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@ -342,8 +342,8 @@ define amdgpu_ps i64 @s_srem_i64(i64 inreg %num, i64 inreg %den) {
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|
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|
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|
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|
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@ -1271,21 +1271,22 @@ define <2 x i64> @v_srem_v2i64_pow2k_denom(<2 x i64> %num) {
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|
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|
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; GISEL-NEXT: v_add_i32_e32 v7, vcc, v7, v8
|
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|
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|
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; GISEL-NEXT: v_add_i32_e32 v7, vcc, v7, v10
|
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; GISEL-NEXT: v_cndmask_b32_e64 v7, 0, 1, vcc
|
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|
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|
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; GISEL-NEXT: v_add_i32_e32 v7, vcc, v8, v7
|
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; GISEL-NEXT: v_mul_hi_u32 v8, v0, v5
|
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|
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|
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|
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|
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|
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|
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; GISEL-NEXT: v_add_i32_e32 v8, vcc, v9, v8
|
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; GISEL-NEXT: v_add_i32_e32 v8, vcc, v10, v8
|
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; GISEL-NEXT: v_add_i32_e32 v4, vcc, v4, v7
|
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|
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; GISEL-NEXT: v_add_i32_e32 v7, vcc, v8, v7
|
||||
@ -1300,35 +1301,33 @@ define <2 x i64> @v_srem_v2i64_pow2k_denom(<2 x i64> %num) {
|
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|
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; GISEL-NEXT: v_cmp_le_u32_e64 s[4:5], s9, v5
|
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; GISEL-NEXT: v_mov_b32_e32 v4, s9
|
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; GISEL-NEXT: v_cndmask_b32_e64 v7, 0, -1, s[4:5]
|
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|
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; GISEL-NEXT: v_cmp_le_u32_e64 s[4:5], s8, v0
|
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; GISEL-NEXT: v_cndmask_b32_e64 v8, 0, -1, s[4:5]
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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; GISEL-NEXT: v_subrev_i32_e32 v7, vcc, s8, v0
|
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|
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|
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|
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|
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|
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|
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|
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; GISEL-NEXT: v_cmp_eq_u32_e64 s[4:5], s9, v8
|
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; GISEL-NEXT: v_cndmask_b32_e64 v10, v10, v11, s[4:5]
|
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; GISEL-NEXT: s_add_u32 s4, s10, 0
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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; GISEL-NEXT: s_addc_u32 s5, 0, 0
|
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|
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|
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|
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|
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|
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; GISEL-NEXT: v_cndmask_b32_e32 v7, v7, v9, vcc
|
||||
; GISEL-NEXT: v_cndmask_b32_e32 v1, v8, v1, vcc
|
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; GISEL-NEXT: v_cmp_ne_u32_e32 vcc, 0, v4
|
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; GISEL-NEXT: v_cndmask_b32_e32 v1, v5, v1, vcc
|
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|
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|
||||
@ -1338,141 +1337,142 @@ define <2 x i64> @v_srem_v2i64_pow2k_denom(<2 x i64> %num) {
|
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|
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|
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|
||||
; GISEL-NEXT: s_subb_u32 s9, 0, s7
|
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; GISEL-NEXT: v_ashrrev_i32_e32 v7, 31, v3
|
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; GISEL-NEXT: v_mul_f32_e32 v4, 0x5f7ffffc, v4
|
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|
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|
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|
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|
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|
||||
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|
||||
; GISEL-NEXT: v_addc_u32_e32 v3, vcc, v3, v7, vcc
|
||||
; GISEL-NEXT: v_mul_lo_u32 v8, s9, v4
|
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; GISEL-NEXT: v_mul_lo_u32 v9, s8, v5
|
||||
; GISEL-NEXT: v_mul_hi_u32 v11, s8, v4
|
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|
||||
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|
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|
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|
||||
; GISEL-NEXT: v_mul_lo_u32 v7, s9, v4
|
||||
; GISEL-NEXT: v_mul_lo_u32 v8, s8, v5
|
||||
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|
||||
; GISEL-NEXT: v_mul_hi_u32 v10, s8, v4
|
||||
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|
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|
||||
; GISEL-NEXT: v_mul_lo_u32 v9, s8, v4
|
||||
; GISEL-NEXT: v_add_i32_e32 v2, vcc, v2, v6
|
||||
; GISEL-NEXT: v_addc_u32_e32 v3, vcc, v3, v6, vcc
|
||||
; GISEL-NEXT: v_add_i32_e32 v7, vcc, v7, v8
|
||||
; GISEL-NEXT: v_add_i32_e32 v7, vcc, v7, v10
|
||||
; GISEL-NEXT: v_mul_lo_u32 v8, v5, v9
|
||||
; GISEL-NEXT: v_mul_lo_u32 v10, v4, v7
|
||||
; GISEL-NEXT: v_mul_hi_u32 v11, v4, v9
|
||||
; GISEL-NEXT: v_mul_hi_u32 v9, v5, v9
|
||||
; GISEL-NEXT: v_xor_b32_e32 v2, v2, v6
|
||||
; GISEL-NEXT: v_add_i32_e32 v8, vcc, v8, v10
|
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; GISEL-NEXT: v_cndmask_b32_e64 v10, 0, 1, vcc
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; GISEL-NEXT: v_mul_hi_u32 v10, v5, v10
|
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; GISEL-NEXT: v_xor_b32_e32 v2, v2, v7
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|
||||
; GISEL-NEXT: v_mul_hi_u32 v9, v2, v5
|
||||
; GISEL-NEXT: v_mul_hi_u32 v5, v3, v5
|
||||
; GISEL-NEXT: v_add_i32_e32 v4, vcc, v8, v4
|
||||
; GISEL-NEXT: v_mov_b32_e32 v9, s7
|
||||
; GISEL-NEXT: v_add_i32_e32 v7, vcc, v7, v8
|
||||
; GISEL-NEXT: v_cndmask_b32_e64 v8, 0, 1, vcc
|
||||
; GISEL-NEXT: v_add_i32_e32 v4, vcc, v4, v9
|
||||
; GISEL-NEXT: v_cndmask_b32_e64 v9, 0, 1, vcc
|
||||
; GISEL-NEXT: v_add_i32_e32 v8, vcc, v8, v9
|
||||
; GISEL-NEXT: v_add_i32_e32 v4, vcc, v4, v6
|
||||
; GISEL-NEXT: v_cndmask_b32_e64 v6, 0, 1, vcc
|
||||
; GISEL-NEXT: v_add_i32_e32 v6, vcc, v8, v6
|
||||
; GISEL-NEXT: v_add_i32_e32 v5, vcc, v5, v6
|
||||
; GISEL-NEXT: v_mul_lo_u32 v6, s7, v4
|
||||
; GISEL-NEXT: v_add_i32_e32 v7, vcc, v7, v10
|
||||
; GISEL-NEXT: v_cndmask_b32_e64 v7, 0, 1, vcc
|
||||
; GISEL-NEXT: v_mul_lo_u32 v10, v3, v5
|
||||
; GISEL-NEXT: v_add_i32_e32 v7, vcc, v8, v7
|
||||
; GISEL-NEXT: v_mul_hi_u32 v8, v2, v5
|
||||
; GISEL-NEXT: v_mul_hi_u32 v5, v3, v5
|
||||
; GISEL-NEXT: v_add_i32_e32 v4, vcc, v10, v4
|
||||
; GISEL-NEXT: v_cndmask_b32_e64 v10, 0, 1, vcc
|
||||
; GISEL-NEXT: v_add_i32_e32 v4, vcc, v4, v8
|
||||
; GISEL-NEXT: v_cndmask_b32_e64 v8, 0, 1, vcc
|
||||
; GISEL-NEXT: v_add_i32_e32 v8, vcc, v10, v8
|
||||
; GISEL-NEXT: v_add_i32_e32 v4, vcc, v4, v7
|
||||
; GISEL-NEXT: v_cndmask_b32_e64 v7, 0, 1, vcc
|
||||
; GISEL-NEXT: v_add_i32_e32 v7, vcc, v8, v7
|
||||
; GISEL-NEXT: v_add_i32_e32 v5, vcc, v5, v7
|
||||
; GISEL-NEXT: v_mul_lo_u32 v7, s7, v4
|
||||
; GISEL-NEXT: v_mul_lo_u32 v5, s6, v5
|
||||
; GISEL-NEXT: v_mul_lo_u32 v8, s6, v4
|
||||
; GISEL-NEXT: v_mul_hi_u32 v4, s6, v4
|
||||
; GISEL-NEXT: v_add_i32_e32 v5, vcc, v6, v5
|
||||
; GISEL-NEXT: v_add_i32_e32 v5, vcc, v7, v5
|
||||
; GISEL-NEXT: v_add_i32_e32 v4, vcc, v5, v4
|
||||
; GISEL-NEXT: v_sub_i32_e32 v2, vcc, v2, v8
|
||||
; GISEL-NEXT: v_subb_u32_e64 v5, s[4:5], v3, v4, vcc
|
||||
; GISEL-NEXT: v_sub_i32_e64 v3, s[4:5], v3, v4
|
||||
; GISEL-NEXT: v_cmp_le_u32_e64 s[4:5], s7, v5
|
||||
; GISEL-NEXT: v_mov_b32_e32 v4, s7
|
||||
; GISEL-NEXT: v_cndmask_b32_e64 v6, 0, -1, s[4:5]
|
||||
; GISEL-NEXT: v_cndmask_b32_e64 v4, 0, -1, s[4:5]
|
||||
; GISEL-NEXT: v_cmp_le_u32_e64 s[4:5], s6, v2
|
||||
; GISEL-NEXT: v_cndmask_b32_e64 v8, 0, -1, s[4:5]
|
||||
; GISEL-NEXT: v_cndmask_b32_e64 v7, 0, -1, s[4:5]
|
||||
; GISEL-NEXT: v_cmp_eq_u32_e64 s[4:5], s7, v5
|
||||
; GISEL-NEXT: v_subb_u32_e32 v3, vcc, v3, v4, vcc
|
||||
; GISEL-NEXT: v_cndmask_b32_e64 v6, v6, v8, s[4:5]
|
||||
; GISEL-NEXT: v_subrev_i32_e32 v8, vcc, s6, v2
|
||||
; GISEL-NEXT: v_subbrev_u32_e64 v9, s[4:5], 0, v3, vcc
|
||||
; GISEL-NEXT: v_cmp_le_u32_e64 s[4:5], s7, v9
|
||||
; GISEL-NEXT: v_subb_u32_e32 v3, vcc, v3, v4, vcc
|
||||
; GISEL-NEXT: v_subb_u32_e32 v3, vcc, v3, v9, vcc
|
||||
; GISEL-NEXT: v_cndmask_b32_e64 v4, v4, v7, s[4:5]
|
||||
; GISEL-NEXT: v_subrev_i32_e32 v7, vcc, s6, v2
|
||||
; GISEL-NEXT: v_subbrev_u32_e64 v8, s[4:5], 0, v3, vcc
|
||||
; GISEL-NEXT: v_cmp_le_u32_e64 s[4:5], s7, v8
|
||||
; GISEL-NEXT: v_subb_u32_e32 v3, vcc, v3, v9, vcc
|
||||
; GISEL-NEXT: v_cndmask_b32_e64 v10, 0, -1, s[4:5]
|
||||
; GISEL-NEXT: v_cmp_le_u32_e64 s[4:5], s6, v8
|
||||
; GISEL-NEXT: v_subrev_i32_e32 v4, vcc, s6, v8
|
||||
; GISEL-NEXT: v_cmp_le_u32_e64 s[4:5], s6, v7
|
||||
; GISEL-NEXT: v_subrev_i32_e32 v9, vcc, s6, v7
|
||||
; GISEL-NEXT: v_cndmask_b32_e64 v11, 0, -1, s[4:5]
|
||||
; GISEL-NEXT: v_cmp_eq_u32_e64 s[4:5], s7, v9
|
||||
; GISEL-NEXT: v_cmp_eq_u32_e64 s[4:5], s7, v8
|
||||
; GISEL-NEXT: v_cndmask_b32_e64 v10, v10, v11, s[4:5]
|
||||
; GISEL-NEXT: v_subbrev_u32_e32 v3, vcc, 0, v3, vcc
|
||||
; GISEL-NEXT: v_cmp_ne_u32_e32 vcc, 0, v10
|
||||
; GISEL-NEXT: v_cndmask_b32_e32 v4, v8, v4, vcc
|
||||
; GISEL-NEXT: v_cndmask_b32_e32 v3, v9, v3, vcc
|
||||
; GISEL-NEXT: v_cmp_ne_u32_e32 vcc, 0, v6
|
||||
; GISEL-NEXT: v_cndmask_b32_e32 v2, v2, v4, vcc
|
||||
; GISEL-NEXT: v_cndmask_b32_e32 v7, v7, v9, vcc
|
||||
; GISEL-NEXT: v_cndmask_b32_e32 v3, v8, v3, vcc
|
||||
; GISEL-NEXT: v_cmp_ne_u32_e32 vcc, 0, v4
|
||||
; GISEL-NEXT: v_cndmask_b32_e32 v2, v2, v7, vcc
|
||||
; GISEL-NEXT: v_cndmask_b32_e32 v3, v5, v3, vcc
|
||||
; GISEL-NEXT: v_xor_b32_e32 v2, v2, v7
|
||||
; GISEL-NEXT: v_xor_b32_e32 v3, v3, v7
|
||||
; GISEL-NEXT: v_sub_i32_e32 v2, vcc, v2, v7
|
||||
; GISEL-NEXT: v_subb_u32_e32 v3, vcc, v3, v7, vcc
|
||||
; GISEL-NEXT: v_xor_b32_e32 v2, v2, v6
|
||||
; GISEL-NEXT: v_xor_b32_e32 v3, v3, v6
|
||||
; GISEL-NEXT: v_sub_i32_e32 v2, vcc, v2, v6
|
||||
; GISEL-NEXT: v_subb_u32_e32 v3, vcc, v3, v6, vcc
|
||||
; GISEL-NEXT: s_setpc_b64 s[30:31]
|
||||
;
|
||||
; CGP-LABEL: v_srem_v2i64_oddk_denom:
|
||||
|
||||
27
test/CodeGen/AMDGPU/sgpr-copy-local-cse.ll
Normal file
27
test/CodeGen/AMDGPU/sgpr-copy-local-cse.ll
Normal file
@ -0,0 +1,27 @@
|
||||
; RUN: llc -mtriple=amdgcn-amd-amdhsa -mcpu=gfx906 -verify-machineinstrs -o - %s | FileCheck %s
|
||||
|
||||
target datalayout = "e-p:64:64-p1:64:64-p2:32:32-p3:32:32-p4:64:64-p5:32:32-p6:32:32-i64:64-v16:16-v24:32-v32:32-v48:64-v96:128-v192:256-v256:256-v512:512-v1024:1024-v2048:2048-n32:64-S32-A5-ni:7"
|
||||
target triple = "amdgcn-amd-amdhsa"
|
||||
|
||||
; CHECK-LABEL: {{^}}t0:
|
||||
; CHECK: s_load_dwordx2 s{{\[}}[[PTR_LO:[0-9]+]]:[[PTR_HI:[0-9]+]]], s[4:5], 0x0
|
||||
; CHECK: v_mov_b32_e32 v{{[0-9]+}}, s[[PTR_HI]]
|
||||
; There should be no redundant copies from PTR_HI.
|
||||
; CHECK-NOT: v_mov_b32_e32 v{{[0-9]+}}, s[[PTR_HI]]
|
||||
define protected amdgpu_kernel void @t0(float addrspace(1)* %p, i32 %i0, i32 %j0, i32 %k0) {
|
||||
entry:
|
||||
%0 = tail call i32 @llvm.amdgcn.workitem.id.x()
|
||||
%i = add i32 %0, %i0
|
||||
%j = add i32 %0, %j0
|
||||
%k = add i32 %0, %k0
|
||||
%pi = getelementptr float, float addrspace(1)* %p, i32 %i
|
||||
%vi = load float, float addrspace(1)* %pi
|
||||
%pj = getelementptr float, float addrspace(1)* %p, i32 %j
|
||||
%vj = load float, float addrspace(1)* %pj
|
||||
%sum = fadd float %vi, %vj
|
||||
%pk = getelementptr float, float addrspace(1)* %p, i32 %k
|
||||
store float %sum, float addrspace(1)* %pk
|
||||
ret void
|
||||
}
|
||||
|
||||
declare i32 @llvm.amdgcn.workitem.id.x()
|
||||
@ -153,7 +153,9 @@ bb:
|
||||
|
||||
; GCN-LABEL: barrier_vmcnt_vscnt_flat_workgroup:
|
||||
; GCN: flat_load_dword
|
||||
; GCN: s_waitcnt vmcnt(0) lgkmcnt(0){{$}}
|
||||
; GFX8_9: s_waitcnt lgkmcnt(0){{$}}
|
||||
; GFX8_9: s_waitcnt vmcnt(0){{$}}
|
||||
; GFX10: s_waitcnt vmcnt(0) lgkmcnt(0){{$}}
|
||||
; GFX10: s_waitcnt_vscnt null, 0x0
|
||||
; GCN-NEXT: s_barrier
|
||||
define amdgpu_kernel void @barrier_vmcnt_vscnt_flat_workgroup(i32* %arg) {
|
||||
|
||||
@ -18,15 +18,15 @@ entry:
|
||||
define arm_aapcs_vfpcc <8 x float> @fpext_8(<8 x half> %src1) {
|
||||
; CHECK-LABEL: fpext_8:
|
||||
; CHECK: @ %bb.0: @ %entry
|
||||
; CHECK-NEXT: vmov q2, q0
|
||||
; CHECK-NEXT: vcvtt.f32.f16 s3, s9
|
||||
; CHECK-NEXT: vcvtt.f32.f16 s7, s11
|
||||
; CHECK-NEXT: vcvtb.f32.f16 s2, s9
|
||||
; CHECK-NEXT: vcvtb.f32.f16 s6, s11
|
||||
; CHECK-NEXT: vcvtt.f32.f16 s1, s8
|
||||
; CHECK-NEXT: vcvtt.f32.f16 s5, s10
|
||||
; CHECK-NEXT: vcvtb.f32.f16 s0, s8
|
||||
; CHECK-NEXT: vcvtb.f32.f16 s4, s10
|
||||
; CHECK-NEXT: vcvtt.f32.f16 s11, s1
|
||||
; CHECK-NEXT: vcvtt.f32.f16 s7, s3
|
||||
; CHECK-NEXT: vcvtb.f32.f16 s10, s1
|
||||
; CHECK-NEXT: vcvtb.f32.f16 s6, s3
|
||||
; CHECK-NEXT: vcvtt.f32.f16 s9, s0
|
||||
; CHECK-NEXT: vcvtt.f32.f16 s5, s2
|
||||
; CHECK-NEXT: vcvtb.f32.f16 s8, s0
|
||||
; CHECK-NEXT: vcvtb.f32.f16 s4, s2
|
||||
; CHECK-NEXT: vmov q0, q2
|
||||
; CHECK-NEXT: bx lr
|
||||
entry:
|
||||
%out = fpext <8 x half> %src1 to <8 x float>
|
||||
|
||||
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