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synced 2024-10-19 02:52:53 +02:00
[AArch64][GlobalISel] Robustize select tests. NFC.
Using the same register means nothing was checking for operand order. llvm-svn: 278803
This commit is contained in:
parent
c8ea56c27b
commit
9abfe90706
@ -51,19 +51,23 @@ regBankSelected: true
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# CHECK: registers:
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# CHECK-NEXT: - { id: 0, class: gpr32 }
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# CHECK-NEXT: - { id: 1, class: gpr32 }
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# CHECK-NEXT: - { id: 2, class: gpr32 }
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registers:
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- { id: 0, class: gpr }
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- { id: 1, class: gpr }
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- { id: 2, class: gpr }
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# CHECK: body:
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# CHECK: %0 = COPY %w0
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# CHECK: %1 = ADDWrr %0, %0
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# CHECK: %1 = COPY %w1
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# CHECK: %2 = ADDWrr %0, %1
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body: |
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bb.0:
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liveins: %w0
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liveins: %w0, %w1
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%0(32) = COPY %w0
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||||
%1(32) = G_ADD s32 %0, %0
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||||
%1(32) = COPY %w1
|
||||
%2(32) = G_ADD s32 %0, %1
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...
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---
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@ -77,19 +81,23 @@ regBankSelected: true
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# CHECK: registers:
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# CHECK-NEXT: - { id: 0, class: gpr64 }
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||||
# CHECK-NEXT: - { id: 1, class: gpr64 }
|
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# CHECK-NEXT: - { id: 2, class: gpr64 }
|
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registers:
|
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- { id: 0, class: gpr }
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- { id: 1, class: gpr }
|
||||
- { id: 2, class: gpr }
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# CHECK: body:
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# CHECK: %0 = COPY %x0
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# CHECK: %1 = ADDXrr %0, %0
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# CHECK: %1 = COPY %x1
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# CHECK: %2 = ADDXrr %0, %1
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body: |
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bb.0:
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liveins: %x0
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liveins: %x0, %x1
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%0(64) = COPY %x0
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%1(64) = G_ADD s64 %0, %0
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%1(64) = COPY %x1
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%2(64) = G_ADD s64 %0, %1
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...
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@ -103,19 +111,23 @@ regBankSelected: true
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# CHECK: registers:
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# CHECK-NEXT: - { id: 0, class: gpr32 }
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# CHECK-NEXT: - { id: 1, class: gpr32 }
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# CHECK-NEXT: - { id: 2, class: gpr32 }
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registers:
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- { id: 0, class: gpr }
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- { id: 1, class: gpr }
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- { id: 2, class: gpr }
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# CHECK: body:
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# CHECK: %0 = COPY %w0
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# CHECK: %1 = SUBWrr %0, %0
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# CHECK: %1 = COPY %w1
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# CHECK: %2 = SUBWrr %0, %1
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body: |
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bb.0:
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liveins: %w0
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liveins: %w0, %w1
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%0(32) = COPY %w0
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||||
%1(32) = G_SUB s32 %0, %0
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||||
%1(32) = COPY %w1
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||||
%2(32) = G_SUB s32 %0, %1
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...
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@ -129,19 +141,23 @@ regBankSelected: true
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# CHECK: registers:
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# CHECK-NEXT: - { id: 0, class: gpr64 }
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# CHECK-NEXT: - { id: 1, class: gpr64 }
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# CHECK-NEXT: - { id: 2, class: gpr64 }
|
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registers:
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- { id: 0, class: gpr }
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- { id: 1, class: gpr }
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- { id: 2, class: gpr }
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# CHECK: body:
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# CHECK: %0 = COPY %x0
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# CHECK: %1 = SUBXrr %0, %0
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# CHECK: %1 = COPY %x1
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# CHECK: %2 = SUBXrr %0, %1
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body: |
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bb.0:
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liveins: %x0
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liveins: %x0, %x1
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%0(64) = COPY %x0
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%1(64) = G_SUB s64 %0, %0
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%1(64) = COPY %x1
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||||
%2(64) = G_SUB s64 %0, %1
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...
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@ -155,19 +171,23 @@ regBankSelected: true
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# CHECK: registers:
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# CHECK-NEXT: - { id: 0, class: gpr32 }
|
||||
# CHECK-NEXT: - { id: 1, class: gpr32 }
|
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# CHECK-NEXT: - { id: 2, class: gpr32 }
|
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registers:
|
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- { id: 0, class: gpr }
|
||||
- { id: 1, class: gpr }
|
||||
- { id: 2, class: gpr }
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# CHECK: body:
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# CHECK: %0 = COPY %w0
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# CHECK: %1 = ORRWrr %0, %0
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# CHECK: %1 = COPY %w1
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# CHECK: %2 = ORRWrr %0, %1
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body: |
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bb.0:
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liveins: %w0
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liveins: %w0, %w1
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%1(32) = COPY %w1
|
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%2(32) = G_OR s32 %0, %1
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...
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@ -181,19 +201,23 @@ regBankSelected: true
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# CHECK: registers:
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# CHECK-NEXT: - { id: 0, class: gpr64 }
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# CHECK-NEXT: - { id: 1, class: gpr64 }
|
||||
# CHECK-NEXT: - { id: 2, class: gpr64 }
|
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registers:
|
||||
- { id: 0, class: gpr }
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||||
- { id: 1, class: gpr }
|
||||
- { id: 2, class: gpr }
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# CHECK: body:
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# CHECK: %0 = COPY %x0
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# CHECK: %1 = ORRXrr %0, %0
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# CHECK: %1 = COPY %x1
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# CHECK: %2 = ORRXrr %0, %1
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body: |
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bb.0:
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liveins: %x0
|
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liveins: %x0, %x1
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%0(64) = COPY %x0
|
||||
%1(64) = G_OR s64 %0, %0
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||||
%1(64) = COPY %x1
|
||||
%2(64) = G_OR s64 %0, %1
|
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...
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@ -207,19 +231,23 @@ regBankSelected: true
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# CHECK: registers:
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# CHECK-NEXT: - { id: 0, class: gpr32 }
|
||||
# CHECK-NEXT: - { id: 1, class: gpr32 }
|
||||
# CHECK-NEXT: - { id: 2, class: gpr32 }
|
||||
registers:
|
||||
- { id: 0, class: gpr }
|
||||
- { id: 1, class: gpr }
|
||||
- { id: 2, class: gpr }
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# CHECK: body:
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# CHECK: %0 = COPY %w0
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# CHECK: %1 = EORWrr %0, %0
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# CHECK: %1 = COPY %w1
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# CHECK: %2 = EORWrr %0, %1
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body: |
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bb.0:
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liveins: %w0
|
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liveins: %w0, %w1
|
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||||
%0(32) = COPY %w0
|
||||
%1(32) = G_XOR s32 %0, %0
|
||||
%1(32) = COPY %w1
|
||||
%2(32) = G_XOR s32 %0, %1
|
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...
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||||
@ -233,19 +261,23 @@ regBankSelected: true
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# CHECK: registers:
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# CHECK-NEXT: - { id: 0, class: gpr64 }
|
||||
# CHECK-NEXT: - { id: 1, class: gpr64 }
|
||||
# CHECK-NEXT: - { id: 2, class: gpr64 }
|
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registers:
|
||||
- { id: 0, class: gpr }
|
||||
- { id: 1, class: gpr }
|
||||
- { id: 2, class: gpr }
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# CHECK: body:
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# CHECK: %0 = COPY %x0
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# CHECK: %1 = EORXrr %0, %0
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# CHECK: %1 = COPY %x1
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# CHECK: %2 = EORXrr %0, %1
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body: |
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bb.0:
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liveins: %x0
|
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liveins: %x0, %x1
|
||||
|
||||
%0(64) = COPY %x0
|
||||
%1(64) = G_XOR s64 %0, %0
|
||||
%1(64) = COPY %x1
|
||||
%2(64) = G_XOR s64 %0, %1
|
||||
...
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||||
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---
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@ -259,19 +291,23 @@ regBankSelected: true
|
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# CHECK: registers:
|
||||
# CHECK-NEXT: - { id: 0, class: gpr32 }
|
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# CHECK-NEXT: - { id: 1, class: gpr32 }
|
||||
# CHECK-NEXT: - { id: 2, class: gpr32 }
|
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registers:
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||||
- { id: 0, class: gpr }
|
||||
- { id: 1, class: gpr }
|
||||
- { id: 2, class: gpr }
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# CHECK: body:
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# CHECK: %0 = COPY %w0
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# CHECK: %1 = ANDWrr %0, %0
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# CHECK: %1 = COPY %w1
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# CHECK: %2 = ANDWrr %0, %1
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body: |
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bb.0:
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liveins: %w0
|
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liveins: %w0, %w1
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||||
%0(32) = COPY %w0
|
||||
%1(32) = G_AND s32 %0, %0
|
||||
%1(32) = COPY %w1
|
||||
%2(32) = G_AND s32 %0, %1
|
||||
...
|
||||
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||||
---
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||||
@ -285,19 +321,23 @@ regBankSelected: true
|
||||
# CHECK: registers:
|
||||
# CHECK-NEXT: - { id: 0, class: gpr64 }
|
||||
# CHECK-NEXT: - { id: 1, class: gpr64 }
|
||||
# CHECK-NEXT: - { id: 2, class: gpr64 }
|
||||
registers:
|
||||
- { id: 0, class: gpr }
|
||||
- { id: 1, class: gpr }
|
||||
- { id: 2, class: gpr }
|
||||
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# CHECK: body:
|
||||
# CHECK: %0 = COPY %x0
|
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# CHECK: %1 = ANDXrr %0, %0
|
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# CHECK: %1 = COPY %x1
|
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# CHECK: %2 = ANDXrr %0, %1
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body: |
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bb.0:
|
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liveins: %x0
|
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liveins: %x0, %x1
|
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%0(64) = COPY %x0
|
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%1(64) = G_AND s64 %0, %0
|
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%1(64) = COPY %x1
|
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%2(64) = G_AND s64 %0, %1
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...
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